FPGA/ASIC Verilog-learn-note 返回
项目作者： luckymei

项目描述 ：
记录一些Verilog的基础知识
高级语言：
项目地址: git://github.com/luckymei/Verilog-learn-note.git
创建时间： 2018-05-19T02:16:35Z
项目社区：https://github.com/luckymei/Verilog-learn-note
开源协议：
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