项目描述 ：
RISC-V RV32I CPU written in verilog

高级语言： Verilog

项目主页：

项目地址: git://github.com/franzflasch/leiwand_rv32.git

创建时间： 2019-06-14T11:50:23Z
项目社区：https://github.com/franzflasch/leiwand_rv32
开源协议：GNU General Public License v3.0
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