项目描述 ：
generic Verilog modules for reuse...

高级语言： SystemVerilog

项目主页：

项目地址: git://github.com/TM90/VerilogModules.git

创建时间： 2014-01-23T18:53:53Z
项目社区：https://github.com/TM90/VerilogModules
开源协议：
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